EPI (European Processor Initiative) completa con éxito la fase 1
El proyecto EPI (European Processor Initiative) ha completado con éxito la primera fase en estos tres años de vida (2018-2021).
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RISC-V
RISC-V. OpenCores.org. Microarquitectura. ISA. Microprocesador. CPU.
James Prior of SiFive: Exclusive interview for AT
New exclusive interview with James Prior for the blog AT. He is the Head of Global Communications for SiFive, a
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James Prior de SiFive: Entrevista exclusiva para AT
Nueva entrevista exclusiva con James Prior para el blog AT. Él es el Jefe de Comunicaciones Globales de SiFive, una
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¡Feliz II cumpleaños De-RISC!
Si lees frecuentemente este blog seguro que ya sabes qué es el proyecto De-RISC., cuyo objetivo es crear la primera
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xv6: un sistema operativo simple para RISC-V
Si lo recuerdas, hace un tiempo publiqué un artículo sobre algunos recursos que podías usar para trabajar con RISC-V, y
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EPI EPAC 1.0: las primeras muestras de chip han sido entregadas
EPI (European Processor Initiative) sigue dando pasos en el camino hacia la no dependencia europea en el ámbito de la
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QEMU: Cómo emular RISC-V en Linux
A diferencia de un software de virtualización como VirtualBox, que emplea la propia arquitectura de la máquina anfitriona, con QEMU
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SiPearl abre su segunda filial internacional en España
SiPearl continúa avanzando hacia la culminación del diseño del microprocesador que equiparán los supercomputadores de exaescala de los centros de
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EPI: EPAC1.0 Test Chip lanzado para fabricación
La European Processor Initiative (EPI) ha comunicado otro nuevo hito en su proyecto para crear el microprocesador europeo para ayudar
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SiPearl contratará 10 ingenieros al mes hasta alcanzar 1000 empleados en 2025
SiPearl sigue avanzando a nivel técnico y creciendo como empresa. Prueba de ello es la contratación de 10 ingenieros al
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